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Foram encontradas 50 questões.

1397840 Ano: 2012
Disciplina: Português
Banca: FUNRIO
Orgão: CEITEC
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Assinale a afirmativa incorreta exarada sobre o seguinte texto:

“Fiz um acordo de coexistência pacífica com o tempo: nem ele me persegue, nem eu fujo dele. Um dia, a gente se encontra.” (Mário Lago)

 

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1395796 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Assinale a alternativa incorreta sobre DRC e/ou LVS.
 

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1395293 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Sobre clock skew, é correto afirmar que
 

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1394914 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Com relação às etapas do fluxo de projeto, considere as afirmativas abaixo:
I – Floorplanning é o processo de posicionar as células em locais apropriados dentro do chip.
II – Na análise estática de tempo (STA), o projetista cria vetores de teste que são simulados utilizando a gate-level netlist para verificar os requisitos de tempo.
III – Na etapa de floorplannig ocorre o planejamento das linhas de alimentação do chip.
Está correto APENAS o que se afirma em:
 

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1394161 Ano: 2012
Disciplina: Português
Banca: FUNRIO
Orgão: CEITEC
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Marque a alternativa em que se identifica corretamente o desvio praticado em relação à norma escrita padrão brasileira:

 

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1393943 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
O consumo de potência é uma parte critica no projeto de SoC (System-on-a-Chip), sendo um dos requisitos mais importantes de um chip. Sobre o consumo de potência, é correto afirmar o seguinte:
 

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1392629 Ano: 2012
Disciplina: Português
Banca: FUNRIO
Orgão: CEITEC
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“Abro esta crônica como uma janela – Bom dia – e nela me debruço para conversar contigo, leitor casual. E nela me debruçarei, se Deus quiser, todas as quintas e domingos, quer chova, quer faça sol. Essa disposição evidentemente não é minha, que preferiria tomar o calor ou a chuva por desculpa para adiar a conversa... Mas a janela está aberta, e o dia balança suas folhas e suas toalhas nesta manhã de Ipanema.” (Ferreira Gullar)

A leitura atenta do excerto acima revela que uma das alternativas abaixo está incorreta. Assinale-a.

 

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1391905 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Para a realização do clock-gating são utilizadas, principalmente, duas arquiteturas. Uma utilizando apenas uma porta 'AND' (ou 'OR' dependendo da borda de ativação) e outra com a inclusão de um latch, conforme mostrado nas figuras i e ii respectivamente.
Enunciado 1391905-1
Figura I.
Enunciado 1391905-2
Figura II.
Sobre as características de cada topologia pode-se afirmar:
 

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1390256 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
O que visa a técnica de Multi-supply voltage, e qual o mecanismo empregado?
 

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1389758 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
A figura mostra um esquema simplificado dos atrasos (sem os tempos de 'clock to Q').
Enunciado 1389758-1
Determine a frequência máxima que pode ser atingida pelo clock.
 

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