2235334
Ano: 2013
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFMG
Orgão: UFMG
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFMG
Orgão: UFMG
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Um processador tem um ciclo de operação igual a 10 ns. Ele gasta um ciclo para fazer a busca de uma instrução, um ciclo para decodificar cada instrução, dois ciclos para buscar os operandos necessários, três ciclos para executar a instrução e dois ciclos para armazenar o resultado correspondente em algum registrador. Se a organização dessa máquina for estritamente sequencial, qual será o período de execução de uma instrução? Se utilizarmos latches de 3 ns de atraso e considerarmos cada módulo como indivisível, qual será o período do pipeline se a máquina for organizada segundo uma estrutura de cinco estágios?