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2038201 Ano: 2021
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: DIRENS Aeronáutica
Orgão: CIAAR

O grande problema de trabalhar com o sistema binário é o grande número de dígitos para representar valores relativamente pequenos. A versão decimal requer um número menor de dígitos para representar os números de forma compacta. O sistema hexadecimal oferece a vantagem de serem compactos e também serem simples de conversão para números binários.

Nesse sentido, é correto afirmar que o número binário 110101 somado ao número hexadecimal ABC resulta no número em decimal

 

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Com relação aos processadores superescalares e superpipeline., analise as afirmativas a seguir.

I. Arquitetura superescalar - constitui uma técnica de implementação que permite que várias instruções sejam iniciadas simultaneamente e executadas independentemente uma das outras.

II. Arquitetura superpipeline - constitui uma técnica para atingir alto desempenho no processamento, pois explora o fato de que alguns estágios de pipeline executam tarefas que requerem menos de meio ciclo de clock, o que acarreta velocidade de clock dobrada, com aumento no desempenho por ter duas tarefas executadas em um único ciclo de clock.

III. A execução de programas em arquiteturas superescalar e superpipeline apresentam uma diminuição de throughput, que é o número de tarefas concluídas por unidade de tempo, e com isto passa a existir uma queda de desempenho.

Assinale

 

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Pipeline é uma técnica de implementação de processadores, que permite a seguinte funcionalidade

 

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Na comparação entre CISC e RISC, assinale V para a afirmativa verdadeira e F para a falsa.

( ) Um computador RISC parte do pressuposto de que um conjunto simples de instruções vai resultar numa Unidade de Controle simples, barata e rápida. Já os computadores CISC visam criar arquiteturas complexas o bastante a ponto de facilitar a construção dos compiladores, assim, programas complexos são compilados em programas de máquina mais curtos.

( ) Os processadores RISC adotam arquiteturas mais simples e que acessam menos a memória, em favor do acesso aos registradores. A arquitetura Registrador-Registrador é mais adotada, enquanto que os computadores CISC utilizam arquiteturas Registrador-Memória.

( ) Quanto às características, RISC trabalha com instruções que requerem múltiplos ciclos de máquina para execução, variando também com o modo de endereçamento enquanto que CISC trabalha com um conjunto reduzido de instruções, facilitando a organização da Unidade de Controle de modo que esta tenha uma interpretação simples e rápida.

As afirmativas são, respectivamente,

 

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No que diz respeito às arquiteturas paralelas e não convencionais, foi estabelecida uma classificação baseada em fluxo de instruções e de dados, descritas a seguir.

I. Única instrução, único dado – Um único processador executa sequencialmente um conjunto de instruções, usando dados armazenados em uma única memória.

II. Única instrução, múltiplos dados – Uma única instrução é executada ao mesmo tempo sobre múltiplos dados.

III. Única instruções, único dado – Vários processadores executam diferentes instruções no mesmo dado.

IV. Múltiplas instruções, múltiplos dados – Várias instruções são executadas ao mesmo tempo sobre múltiplos dados, o que motivou o surgimento de duas categorias, com as arquiteturas de memória compartilhada e distribuída.

As descrições em I, II, III e IV correspondem, respectivamente, às siglas

 

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Na comparação entre multiprocessadores e multicomputadores, assinale V para a afirmativa verdadeira e F para a falsa.

( ) O multicomputador é um sistema com duas ou mais CPUs, capaz de executar várias tarefas ao mesmo tempo.

( ) O multiprocessador é um sistema com vários processadores conectados por meio de uma rede de interconexão para executar uma tarefa de computação.

( ) Um multiprocessador é um sistema com mais de uma CPU o que permite a execução de diversas tarefas ao mesmo tempo. Em consequência, a falha em um processador não afeta as tarefas dos demais, o que torna um multiprocessador mais confiável.

As afirmativas são, respectivamente,

 

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No que diz respeito aos modos de endereçamento, analise as afirmativas a seguir:

I. Modo DIRETO ou ABSOLUTO – É usado quando um valor está em um registrador. Exemplo: \( Add\ R4,R3 \)

Significado: \( R4 \longleftarrow R4+R3 \)

II. Modo DESLOCAMENTO – É usado para acesso a variáveis locais, além de simular registrador direto e indireto. Exemplo: \( Add\ R4,100\left(R1\right) \)

Significado: \( R4\longleftarrow R4 + \)

\( Mem[R1+100] \)

III. Modo INDEXADO – É usado no endereçamento de vetores, sendo R1 a base do vetor e R2 o índice do elemento. Exemplo: \( Add\ R4,\ \left(R1+R2\right) \)

Significado: \( R4\gets R4+ \)

\( Mem[R1+R2] \)

Assinale

 

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No que diz respeito aos mecanismos de interrupção e de exceção, assinale V para a afirmativa verdadeira e F para a falsa.

( ) Durante a execução de um programa não existe a possibilidade de ocorrerem eventos inesperados, o que elimina desvios forçados no fluxo de execução.

( ) Uma interrupção é sempre gerada por algum evento externo ao programa e, nesse caso, independe da instrução que está sendo executada.

( ) A exceção é resultado direto da execução de uma instrução do próprio programa, como a divisão de um número por zero, ou um overflow em uma operação aritmética.

As afirmativas são, respectivamente,

 

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No que diz respeito aos códigos, os computadores e as redes funcionam com base no sistema binário e hexadecimal. Nesse contexto, quando um internauta digita o número decimal 142, por meio do teclado, as representações binária e hexadecimal na memória do computador são, respectivamente

 

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No que diz respeito às primitivas básicas de programação paralela, controle de tarefas, comunicação e sincronização, na implementação de threads, três modelos de sincronização são descritos a seguir.

I. garante que somente uma thread por vez irá acessar uma seção de código específica ou acessar dados compartilhados – serializa a execução de threads

II. bloqueia threads até que uma condição seja satisfeita

III. coordenam o acesso a recursos, indicando o limite de threads que podem ter acesso concorrente a um recurso

Os três modelos de sincronização em I, II e III são denominados, respectivamente

 

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