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Para o circuito RLC abaixo, qual o valor da frequência de ressonância desse circuito?
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Um controlador Lógico Programável (PLC) é utilizado para sinalizar o término de um processo, onde a leitura é realizada através de 3 (três) sinais sensores (RS1, RS2 e RS3), sinais conforme o circuito abaixo, e para acionar a saída o programador, programou uma lógica digital (LÓGICA PLC). Sabendo que o PLC considera nível lógico “0” para sinais com valores abaixo de 2,999 Volts e considera nível lógico “1” para sinais acima de 3,0 Volts. Qual deve ser o valor resistência mínima para o sensor RS3 habilitar a saída do controlador em nível lógico “1”:
É correto afirmar que o valor de RS3 mínimo é.
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Considerando o sinal de entrada em um circuito na forma: !$ v(t) \, = \, Vm \, Cos (wt) !$, assinale a alternativa correta.
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A partir dos sinais aplicados às entradas da porta da figura abaixo, marque a alternativa que apresenta a forma de onda na saída S.
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Para o circuito da figura abaixo, qual o valor da constante de tempo do circuito?
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Dada a tabela-verdade abaixo, indique sua função booleana mínima.
| A | B | C | D | f(A,B,C,D) |
| 0 | 0 | 0 | 0 | 0 |
| 0 | 0 | 0 | 1 | 1 |
| 0 | 0 | 1 | 0 | 1 |
| 0 | 0 | 1 | 1 | 0 |
| 0 | 1 | 0 | 0 | 1 |
| 0 | 1 | 0 | 1 | x |
| 0 | 1 | 1 | 0 | 1 |
| 0 | 1 | 1 | 1 | 1 |
| 1 | 0 | 0 | 0 | 1 |
| 1 | 0 | 0 | 1 | 1 |
| 1 | 0 | 1 | 0 | 1 |
| 1 | 0 | 1 | 1 |
x
|
| 1 | 1 | 0 | 0 | 0 |
| 1 | 1 | 0 | 1 | 1 |
| 1 | 1 | 1 | 0 | x |
| 1 | 1 | 1 | 1 | 0 |
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Para o circuito mostrado abaixo, assinale a alternativa que identifica, respectivamente, as quantidades i, i1 e i2.
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Quais os valores das correntes no coletor Ic e da corrente de saturação no coletor, IcSat?
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Considere os circuitos (1) e (2) apresentados a seguir, que possuem duas entradas e uma saída, cada. Assinale a alternativa que indica corretamente as implementações lógicas a que se referem os circuitos (1) e (2), respectivamente:
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Sobre elementos digitais armazenadores de memória, leia e analise as afirmativas abaixo:
I. Latches são elementos capazes de armazenar informação binária e são utilizados em circuitos sequenciais síncronos.
II. A diferença fundamental entre um latches e flip-flops é o tempo em que o armazenador está habilitado a mudar o estado lógico da saída, que no caso do flip-flop é superior.
III. Desconsiderando o método de habilitação para mudança de estados, um flip-flop JK e um latch RS possuem a mesma tabela de transição.
IV. A saída !$ \bar{Q} !$ de um flip-flop D possui nível lógico constante e igual a zero se o "clear" do dispositivo é acionado por lógica complementar e está conectado a um sinal de nível lógico alto.
Assinale a alternativa correta.
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